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以下是寄存器配置参数：
Register 0: 01B9
Register 1: 0000
Register 2: 0013
Register 3: 00F1
Register 4: 30EB
Register 5: 0022
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Register 8: 0003
Register 9: 0002
Register 10: 0040
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Register 12: 0202
Register 13: 002C
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Register 18: 0202
Register 19: 0022
Register 20: 0000
Register 21: 0000
Register 40: 0000
Inputs:
Primary Input Frequency: 25
Secondary Input Frequency: 25
Version 1
C1: 0
R2: 560
C2: 15n
R3: 100
C3: 242.5p
Charge Pump: 2.5m
原理图如下：
Y0-Y7都是1.8V电源供电。
yang du：
补充一下，所有通道的差分走线都做了相同的阻抗控制，只有1,2,3通道幅值有问题，0通道幅值偏低，但是勉强满足LVDS电气要求。
yang du：
回复 yang du:
DSP为C6678
yang du：
我将频率调低，峰峰值就变高了
Kailyn Chen：
回复 yang du:
您好，输出幅值测量的时候，端接100ohm电阻了吗？PLL Lock 状态如何？
yang du：
回复 Kailyn Chen:
是端接到C6678的SGMII时钟接口，测了下阻抗是110欧。PLL LOCK状态正常
Kailyn Chen：
回复 yang du:
那测量的时候差分碳棒是否在匹配电阻两端测量的？ 我认为配置没问题，应该是测量方法出问题导致幅值有偏差。
