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TMS320F28377D: 使用GPIO64、GPIO65作为SCIA的收发引脚时发送数据发生丢包情况

Part Number:TMS320F28377D

按如下的配置将GPIO64、65引脚作为SCIA的收发引脚,波特率为9600,每次发送91字节的数据,前30个数据是对的,而后面的数据开始出现混乱,不仅内容是错的而且发送的数据个数也不对。我们在硬件板上用飞线将SCI通信模块的两个引脚连接到GPIO8、GPIO9这两个引脚上,任然使用SCIA模块,同样的配置只修改了GPIO号,发现数据的收发过程一切正常,用示波器抓取GPIO64、GPIO65两个引脚上的波形,得到的波形信号没有明显的干扰,只是发送过程的波形持续时间减少,遍查程序后也没有发现引脚复用的情况。请问GPIO64/65在系统中是否有其他特殊的用途?请各位工程师帮忙分析一下原因。

Links:

您好,

已经收到了您的案例,调查需要些时间,感谢您的耐心等待。

,

Taylor:

GPIO64 to 95默认有输入限定器(Qualifier),从现象看可能是输入限定器配置​​导致的信号同步问题。

具体请参考TRM

,

cmh cmh:

我们并没有配置过输入限定器,请问这种情况应该怎么配置引脚呢?

,

Taylor:

要说GPIO64/65在系统中是否有其他特殊的用途的话,首先考虑到输入限定器。关于设置方法等,请参考TRM中关于输入限定器(Qualifier)的说明。

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