TI中文支持网
TI专业的中文技术问题搜集分享网站

DAC38RF82EVM: 和TSW14J57EVM结合生成信号操作

Part Number:DAC38RF82EVMOther Parts Discussed in Thread:TSW14J57EVM,

您好!

请问:

1,我按照用户手册“TSW14J57 JESD204B High-Speed Data Capture and Pattern Generator Card User's Guide”在HSDC Pro软件上完成“更新固件到DAC”时,按照用户手册指示灯D1、D3、D5~D9、D10、D11、D13~D15、D17~D19、D21、D22长亮,D2闪烁;但是实际情况D2、D6、D7没有亮,且D9、D22亮度较低。我想询问一下原因,如何检测。

2,用户手册“High Speed Data Converter Pro GUI”第67页出现了“Figure 71.HSDC Pro GUI: Lane Rate and REFCLK Settings”显示的是在用HSDC Pro点击“send”向DAC评估板发送测试模式时会弹出的提示框,大致内容为:目前通道速率是7.3728G,来自设备TSW的JESD参考时钟需要设置为368.64M(7.3728G÷20),请问这个是设置哪个地方?

3,为什么我在HSDC Pro软件上生成100k~1G的信号,到了DAC评估板发出的都是以400~600MHz为间隔的信号,和我设置的信号频率毫不相关。

4,DAC38RF8xEVM用户手册“2.1.5”的第8、9条,我使用DAC38RF8xEVM控制软件调节“PLL AUTO TUNE”时,“the PLL LF voltage”一直到不了3或者4,有时候是3或4,但是点击“Reset DAC JESD Core & SYSREF TRIGGER”后就又回到了7,请问该如何设置。

感谢!

Kailyn Chen:

您好,我马上看下您的问题。 

,

Kailyn Chen:

您好,

1. 更新完固件之后,D1、D3、D5~D9这几个灯应该是点亮状态,如果没有检查GUI是否和demo建立连接。

2. 如下,左线选择对应的器件,然后data rate这里输入368.64M。

4. PLL auto tune的话是PLL自动调节,不需要手动调节,如果手动调节它的步长,直到 PLL LF voltage为3或4.

关于您的第三问,因为我这边暂时没有这个板子,无法复制您的现象,我的建议是先检查demo的硬件是否搭建好,包括您的第一个问题也是,先检查硬件部分的连接,包括电源,一些jumper的设置。 

 

 

,

Mei:

您好!

1,请问什么是“demo”?我就是按照用户手册说明先连接上“_DAC38RF8x_LMF_841 ”后,再点击的更新固件,更新完成之后在DAC38RF82EVM板子上的两个灯D9、D10会变成蓝色(这是不是代表两个板子已经连接成功?)但是TSW14J57EVM的D2、D6、D7依旧不亮。

2,提示消息是根据您说的“data rate”的输入数值而改变的,如果我输入“data rate”的是1G,它会提示我“Current lane rate is 10G. JESD reference clock from device EVMto TSW14J57 needs to be set at 250M.”;如果我输入的是384M,它会提示我“Current lane rate is 3.84G. JESD reference clock from device EVMto TSW14J57 needs to be set at 96M.”;如果我输入的是96M,它会提示我“Current lane rate is 960M. JESD reference clock from device EVMto TSW14J57 needs to be set at 另一个数值.”;

3,选择“PLL AUTO TUNE”的话,就不需要管“the PLL LF voltage”的值是多少吗?因为自动调节她一直到不了3或4,手动调节偶尔能到3或4,但是在点击“Reset DAC JESD Core & SYSREF TRIGGER”后就又回到了7。

,

Kailyn Chen:

1. demo指的就是EVM板哈。更新完成之后DAC38RF82EVM板子上的两个灯D9、D10会变成蓝色。应该就是连'接成功了。

2. data rate是可以手动输入的,但是也要依据JESD的参考时钟,输入合适的值,按照它的提示去输入,因为data rate应该是内部clock generation 模块计算出来的,比如它这里提示“Current lane rate is 10G. JESD reference clock from device EVMto TSW14J57 needs to be set at 250M.”那您就输入250试一试。

3.我理解的是,自动调节就不需要再手动配置了。 

,

Mei:

有新的问题请教您

1,配置DAC GUI的时候,在“Quick Start”tab,请问“# of IQ pairs per DAC”中选择一对、两对和“real input”的含义。

2,请问“# of serdes lanes per DAC”的含义。

3,请问“DAC Clock Frequency(MHz)” 和“Sampling rate”有什么关系。

4,请问DAC38RF82EVM上的指示灯D8“JESD SYNC”不亮,该如何解决,是否代表DAC38RF82EVM与TSW14J57EVM未同步成功?

5,按照步骤点击“Reset DAC JESD Core & SYSREF TRIGGER”时,TSW14J57EVM上的指示灯D1灭了一下又亮了,是否代表DAC EVM与TSW EVM没有成功建立同步连接?

,

Kailyn Chen:

您好,新的问题建议您重新建个新帖,以便能及时回复给您。 

赞(0)
未经允许不得转载:TI中文支持网 » DAC38RF82EVM: 和TSW14J57EVM结合生成信号操作
分享到: 更多 (0)

© 2024 TI中文支持网   网站地图 鲁ICP备2022002796号-1