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CDCI6214: 应用问题求解

Part Number:CDCI6214

我司后续生产的加速卡,在配置时钟的时候,存在些问题,可以麻烦帮分析一下吗

时钟芯片: CDCI6214RGER

        原理图设计:同一个板上使用两颗该芯片U9,U10,使用同一个I2C去配置,U9使用EEPROM page1, U10使用Page0,均采用25MHz晶振作为时钟输入源,默认状态是Fallback模式(EEPROMSEL pin/REFSEL floating)

        U9:CH1  LVDS 200MHz

               CH2  LVDS 100MHz

               CH3  HCSL 200MHz

               CH4  LVDS 200MHz

 U10:CH1  LVDS 156.25MHz

                CH2  LVDS 100MHz

                CH3  LVDS 125MHz

                CH4  LVDS 156.25MHz

原理图如图片,附件为U9 配置寄存器值:

  1. U10目前配置成功,U9 只有通道3输出正常,通道1,2,4,均有稳定波形,但是频率值不对。

HexRegVak_U9.txt

R70	0x00460000
R69	0x00450000
R68	0x00440000
R67	0x00430020
R66	0x00420200
R65	0x00410F34
R64	0x0040000D
R63	0x003F0210
R62	0x003E4209
R61	0x003D1500
R60	0x003C0018
R59	0x003B102B
R58	0x003A0008
R57	0x00390A65
R56	0x00380405
R55	0x00370003
R54	0x00360000
R53	0x00358000
R52	0x00340008
R51	0x00330A65
R50	0x00320409
R49	0x00310006
R48	0x00300000
R47	0x002F8000
R46	0x002E0008
R45	0x002D0A65
R44	0x002C0405
R43	0x002B0006
R42	0x002A0000
R41	0x00298000
R40	0x00280008
R39	0x00270A65
R38	0x00260409
R37	0x00250006
R36	0x00240000
R35	0x00238000
R34	0x00220050
R33	0x00210007
R32	0x00200000
R31	0x001F1E72
R30	0x001E5140
R29	0x001D000C
R28	0x001C0000
R27	0x001B0400
R26	0x001A0A18
R25	0x00190000
R24	0x00180001
R23	0x00170000
R22	0x00160000
R21	0x00150000
R20	0x00140000
R19	0x00130000
R18	0x00120000
R17	0x001126C4
R16	0x0010921F
R15	0x000F5037
R14	0x000E0000
R13	0x000D0000
R12	0x000C0000
R11	0x000B0000
R10	0x000A0000
R9	0x00090000 
R8	0x00080000 
R7	0x00070000 
R6	0x00060000 
R5	0x00050008 
R4	0x00040055 
R3	0x00039800 
R2	0x00020053 
R1	0x00016822 
R0	0x00001010 
Kailyn Chen:

您好,U9不正常的1,2,4三个通道如果配置为HSCL 电平,和channel 3一样,输出正常吗?

目前有输出,但频率不对,频差为多少? 

因为fall back模式下,有可能会意外禁用串口,此时我们只能通过OE来输出进行enable。但是根据您的描述,稳定输出指示频率值不对,所以我认为配置应该是没问题的,串口也没被禁用,可以尝试更改通道的输出,比如输出HSCL,或者也和U10 一样,使用EEPROM Page0 验证下是否没问题? 从而确认是不是芯片的问题。

,

Tonyx.wu:

   1)1,2,4三个通道如果配置为HSCL 电平,和channel 3一样,输出正常吗?

        这个尝试还未做,等下可以进行测试。

    2)目前有输出,但频率不对,频差为多少?

        输出不正确的通道1,4 频率大概从100-600MHZ跳,但是波形看起来是很规律的。

    3)因为fall back模式下,有可能会意外禁用串口,此时我们只能通过OE来输出进行enable。

        OE 只进行过一次测量,发现没有问题就没进行测量了,每次进入fallback 模式,都需要确认一下OE 信号吗?

    4)或者也和U10 一样,使用EEPROM Page0 验证下是否没问题

        使用U10 page0 配置验证过,U9通道1可以正常输出156M 频率,所以目前认为芯片也是没问题的。

,

Kailyn Chen:

您好,不正确的频率输出波形可以附上看下吗?

,

Tonyx.wu:

麻烦给我你的邮箱,我把不正确的波形发给你看

另外前些天我们采购了CDCI6214EVM,所以该问题暂停了几天。

    目前CDCI6214EVM已经到了,使用TICS PRO 软件配置PAGE1,并且软件显示PLL LOCKED,可以分别测量出通道1-4频率为:200M,100M,100M,200M。将开发板上配置好的芯片,移到我们自己的板卡上,只有通道3是稳定的100M,其他通道频率会在100-400M跳。请问发生 这个现象是可以定位我们的设计存在问题吗?

,

Kailyn Chen:

您好,根据您的描述,同样的配置在EVM板上四个通道是能正常输出的。

将EVM芯片移到自己的板子上,发现有问题,那么将自己板子上的芯片移到EVM板子上呢?如果同样的现象,可以定位是板子的问题。

硬件电路可以参考EVM user‘s guide中的电路对比一下。

,

Tonyx.wu:

波形情况如附件,分别是u9 通道1,u9通道2。目前只有u9存在这种问题,u10 换芯片是可以正确的。

U9通道1

U9通道2

U9通道4

,

Kailyn Chen:

您好,LVDS波形完全失真。

这样,您是使用差分碳棒测试的吧?建议在靠近测试端,即碳棒端,在LVDS输出正负间端接一个100ohm匹配电阻进行测试。

最简便的方法,用一个100ohm的电阻两端焊接上导线,然后测试的时候将其焊接在LVDS的输出正负之间,注意不是靠近输出端,是靠近测试端,然后再用差分碳棒进行测试,看下波形是否有改善。

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