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ADS1120: 请教下校准的问题

Part Number:ADS1120

使用ADS1120,接的PT100三线,想问下这个的校准应该如何做。查询有资料说两线的可以在PT100短接,三线的是不是三条线都短接,经测试短接后得到的值为0,这个是不是正常。谢谢

Amy Luo:

您好,

您说的是失调校准吗?如下面datasheet截图:

将 PGA 输入 (AINP 和 AINN) 短接至中电源 (AVDD +AVSS) /2 ,然后将输入电压短路的读数结果存储在微控制器中,从而从随后的读数中减去结果。 TI 建议在输入短路的情况下进行多次读数并对结果求平均值,以降低噪音的影响

Jx Wang 说:查询有资料说两线的可以在PT100短接,三线的是不是三条线都短接

您这里是指失调校准操作过程中的短接吗?仅将AD读取差分电压的两条线短接就行

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Jx Wang:

做了测试,得到的结果为0,应该没有影响。我目前的问题是这样的,按手册9.2.2类似方式,使用1.6K精密电阻,配置也和手册类似,使用单次读取,读取到的数据是8941,计算后结果约109多,换算为温度,在24度左右,但现在实际是29左右。这个有什么可能性,我再排查,谢谢。

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Amy Luo:

您计算出来的109是什么值?您计算的RTD电阻值是多少?我算的约是54.57Ω

RRTD = RREF * [Output Code / (Gain * 2^15)]

您试着加热或冷却RTD,看输出code是否与温度变化一致

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Jx Wang:

我算错了,根据公式得出的如您所说。我加热了RTD,这个输出的code与温度的变化是一致的,只是差的太大。我把RREF换的3.24K和1.6K,这两个的结果差别不大,都与实际的温度差挺大的。

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Amy Luo:

从输出公式上看可以知道,输出代码仅与RTD、REF和增益设置有关,因此建议您1、读取寄存器设置,以验证寄存器已正确设置;2、用示波器抓取读取转换结果的时序波形,看读取时序是否正确

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Jx Wang:

谢谢回复。我又进行了测试,寄存器写入是正确的,在写入后又读取进行的比较。读取数据:

    ADS1120SendByte( ADS1120_START_CMD );    Delay_cc( 10 );    ADS1120SendByte( ADS1120_RDATA_CMD );    Delay_cc(10);    temp = ADS1120ReceiveByte();    temp = ( temp << 8 ) | ADS1120ReceiveByte();

得到的数据,仍然和原来相差不大。读取时的波形如图:

上一条线是SCLK,下一条是DOUT,第一个8位是开始转换,第二个8位是读取,后两个是接收。

谢谢

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Jx Wang:

对计算结果相差比较大的问题还没有解决,刚刚订了几种阻值的REF,准备测下看看。对器件在RESET后的延时上再请教一下:在手册中有50us+32*t(clk)的延时,我用正常20sps单次,转换时间为204850,时钟为8M,那这个32*t(clk)在819.4ms以上,这个算法对吧。谢谢

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Amy Luo:

CLK您使用的外部时钟8MHZ是吗,那么t(clk)就是0.125us,复位后的延时就是50us+32*t(clk)=54us

您读取数据时是通过DRDY信号判断的新数据转换完成的吗

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Jx Wang:

谢谢回复。我是使用了DRDY。关于这个延时的,和20SPS没有关系吗,还是说只有在不使用DRDY的时候需要加的延时?目前我实际测试,在RESET后,加比较长的延时才可以WREG成功

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Amy Luo:

抱歉,我刚注意到clk如果外接的话,输入频率范围是0.5 ~ 4.5 MHz,典型值是4.096 MHZ,外接8MHZ是不满足CLK输入范围的,如下datasheet截图

这个 (50 µs + 32 · t(CLK))的延时是RESET命令后需要做的,这样发其他命令才有效

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Jx Wang:

非常感谢,让我学到了很多,谢谢

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